一种50M采样速率CMOS采样/保持电路

doi:10.7523/j.issn.2095-6134.2007.6.010

中国科学院大学学报 ›› 2007, Vol. 24 ›› Issue (6): 788-793.DOI: 10.7523/j.issn.2095-6134.2007.6.010

一种50M采样速率CMOS采样/保持电路

李铁郭立白雪飞

中国科学技术大学电子科学与技术系

收稿日期:1900-01-01 修回日期:1900-01-01 发布日期:2007-11-15

A CMOS high performance 50MSPS sample/hold circuit

LI Tie, GUO Li, BAI Xue-fei

Department of Electronic Science and Technology, USTC

Received:1900-01-01 Revised:1900-01-01 Published:2007-11-15

摘要/Abstract

摘要： 介绍了一种高性能CMOS采样/保持电路，在0.35-μm工艺、3.3-V电源和18-mW功耗下，实现了50-MHz采样频率，输入直到奈奎斯特频率仍能达到10位精度的要求。电路采用全差分结构、底极板采样、栅压自举开关技术、增益自举的折叠共源共栅跨导核心运算放大器和钳制共模电平的电平控制放大器。

关键词: 采样/保持器, CMOS, 栅压自举开关, 增益自举运算放大器

Abstract: A high performance CMOS sample/hold circuit is presented, which achieves the precision of 10-bit over Nyquist band in 50-MHz sampling frequency at 3.3-V supply. This circuit uses full differential circuits, bottom-plate sampling, bootstrap circuits and high performance gain-boost operational amplifier. Simulation in 0.35-μm CMOS process shows the circuit consumes 18-mW of power.

Key words: sample/hold, CMOS, bootstrap, gain-boost operational amplifier

中图分类号:

TN432

李铁郭立白雪飞. 一种50M采样速率CMOS采样/保持电路[J]. 中国科学院大学学报, 2007, 24(6): 788-793.

LI Tie, GUO Li, BAI Xue-fei. A CMOS high performance 50MSPS sample/hold circuit[J]. , 2007, 24(6): 788-793.

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一种50M采样速率CMOS采样/保持电路

A CMOS high performance 50MSPS sample/hold circuit

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